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설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

fpga led제어 질문사항[강의 29분 01초 부분 ]

해결된 질문

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맛비님께,

안녕하세요 fpga부분에서 vitis부분에서 PS부분에 dummy code를 올릴 때 아래와 같은 error로그가 나와서 질문드립니다!

https://support.xilinx.com/s/question/0D52E00006hpJizSAE/cannot-halt-processor-core-timeout-error-seen-when-accessing-pl?language=en_US

위 error log를 고려해보았지만 ip wrapping을 할때 axi를 activation하지도 않았는데 위 error로그가 나오는데 있어 문제가 발생하여 질문드립니다.

답변 2

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신성곤
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동일한 zybo z7-20 입니다! 현재 axi lite led _ blink 실습에도 동일한 에러가 뜹니다 !

에러가 공유해주신 source code에서도 떠서 board 문제인 것인가 생각했는데, 처음 led제어할때는 문제가 없었어서

디버깅이 잘 안되고 있습니다!

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물리적으로는,

  1. 실행시, 보드가 pc 에 usb 로 연결이 잘 되었을까요?

  2. 그리고 강의 1장 잘 되신 건 맞는걸까요?

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주중에 해결이 안되시면, 제가 주말에 해보려고 하는데요.

사용하신 Vitis Tool 버전 남겨주시겠어요?

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2020.2입니다!

1장 실행은 문제없었고, usb또한 pgood에 빨간불이 들어와 있어요 !

led_axi4 실습에 처음에는 cannot halt라고 떴는데 이번에는 아래와 같이 error로그가 뜨네요..

image

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신성곤
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제가 따로 해결해 버렸습니다 :) 감사합니다.

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설계독학맛비
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쿨하게 해결하셨군요??!

다행입니다. 즐공하세요 :)

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설계독학맛비
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안녕하세요 :)

image올려주신 링크에 이런말이 Best 로 올라가 있더라고요.

사용하시는 Board 가 어떤 걸까요?

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