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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

여러분들은 "비메모리 반도체 설계 엔지니어" 입니다. 현업에서 만나요.

강의를 모두 수강하고.. 현업에 대해 여쭈어 보고싶습니다.

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맛비님 시즌1 강의 감사히 잘 들었습니다.
바쁘실것 같아 본문만 바로 쓰겠습니다!
 
지금까지 시스템의 Spec을 설정하고 block diagram을 그리고
EDA tool(Vivado)로 System을 설계하고 Waveform으로
설계한 System의 동작을 확인했는데요.
 
시스템반도체 엔지니어의 역할이 어디까지 인지 궁금합니다.
실제 설계엔지니어는 Wave_form만 보고 끝나진 않을 것 같아서
입니다.
 
Verilog 코딩 후 (RTL 설계) 후 합성(Synthesis) 하면
Gate level 의 Netlist가 나오게 되고
Chip으로 만들기 위해
Layout도 해야 하고 Fab에서 공정이 이루어지고
Chip test까지 과정을 거쳐야 하는 것으로 알고 있습니다.
(중간에 수 많은 Test 과정이 필요하겠지만)
 
1.맛비님과 같은 설계 엔지니어는 현업에서 설계를 한다면
사용하시는 EDA-Tool로 설계 후 어떤 작업까지 직접
하시는지 궁금합니다. (검증 작업, 문서 작업 등등..)
 
2.최종적으로는 맛비님이 작업한 Design Documents가
Backend 회사에 의뢰 될 때 Documents는 무엇으로 구성되어 있는지 궁금합니다!
 
(혹시 제가 사용한 용어중에 틀린것이 있다면 지적해주시면 감사하겠습니다 !)
 
 

답변 1

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설계독학맛비
지식공유자

안녕하세요 :)

굉장히 좋은 질문입니다. + 적어주신 내용은 정확하다 답변드리고 시작하겠습니다.

시스템반도체 엔지니어의 역할이 어디까지 인지 궁금합니다.
실제 설계엔지니어는 Wave_form만 보고 끝나진 않을 것 같아서
입니다.
네, 맞습니다. 기본적으로 Chip 이나오는 순간까지도 설계엔지니어가 끝까지 책임져야 하구요.
Function 은 당연하구요. lint, CDC, Timing Violation 여부, Area, Performance, 등등 많은 부분을 확인해 주셔야 합니다. (모르시는 단어는 구글링 부탁드립니다.)
 
 
1.맛비님과 같은 설계 엔지니어는 현업에서 설계를 한다면
사용하시는 EDA-Tool로 설계 후 어떤 작업까지 직접
하시는지 궁금합니다. (검증 작업, 문서 작업 등등..)
검증, 문서 당연히 설계엔지니어의 역할이구요. 다만 검증이라 하면, 회사의 크기? 에 따라 비례하는 설계하는 HW 에 따라 그 역할 구분이 다를 것 같습니다.
무슨 말이냐면 작고 간단한? 모듈 같은 경우에는 설계엔지니어가 검증까지 합니다.
하지만 시스템이 큰 HW, (대기업가시면 접하실 겁니다.) 들은 검증엔지니어가 별도로 존재하구요. 설계엔지니어가 물론 검증은 해서 전달하지만, 검증 엔지니어가 더 많은 검증을 합니다. 이정도로만 답변드릴께요.
설계만 하면 끝? 은 아닙니다. 전체 기간중에 설계는 30% 정도 되는 것 같네요. 
 
2.최종적으로는 맛비님이 작업한 Design Documents가
Backend 회사에 의뢰 될 때 Documents는 무엇으로 구성되어 있는지 궁금합니다!
이 부분은 제가 담당하질 않아서 정확하게 답변은 못해드릴 것 같아요.
Netlist 하고, Clock 정보, Pin 배치, 모듈배치 등등이 포함되지 않을까 예상합니다. 
 
즐공하세요 :) 
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