24.06.20 23:27 작성
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안녕하세요 맛비님.
FPGA 8장 실습을 진행하고 있습니다.
환경은 아래와 같습니다.
보드: ZYBO Z7-20
VIVADO: 2024.01
VITIS: Classic 2024.01
2022.01 이후 버젼 main.c 코드를 적용하여 사용했습니다.
Makefile에 Code 붙여넣기도 해서 Build 진행시 이상없구요.
Terminal 연결해서 UART 붙는 것 까지는 됐습니다만.. Launch Hardware 진행 후 UART창에서 아무 커맨드가 나오지 않는 현상이 지속됩니다..
프로젝트, 파일 명도 맛비님 강의랑 동일하게 진행했는데 이유가 뭔지 모르겠네요..
관련 증상에 대해 아시는 부분 있으면 답변 부탁드립니다.
답변 5
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2024. 07. 01. 09:14
프로젝트는 맛비님이 올려주신 프로젝트로 진행하면 보드가 정상동작 되긴 합니다.. C코딩의 문제는 아닌것같고 아마 IP생성하는 단계에서 상위버전에서 Cmake파일 제대로 생성되지 않는것처럼 누락되는게 있는게 아닌가 생각드네요..
2024. 07. 16. 10:23
@방지석
버전이슈인것 같아서 해결은 못했습니다. 원인찾을 시간도 없기도하고.. 맛비님이 올려준 프로젝트로 진행하면 잘 동작하는 것을 확인했습니다. 24.01버전으로는 UART통신이 안뜨네요 ㅠㅠ (8장 UART는 24.01로 진행해도 정상동작함)
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2024. 07. 14. 22:56
오.. 다들 혼돈의 카오스 시네요.. ㅠ
버전을 강의랑 맞출 수 있다면 해결이 될 문제라고 보이는데요.
Xil_Out32() 함수의 문제까지는... 제가 해결해드리기 어려울 것 같은데,
버전을 강의와 동일하게 맞춰보는게 어떠실까 권장해드리고 싶습니다.
제가 강의에서 말하고 싶은 중요한 내용은... 아니라고 생각해요..... 빨리 다음 단계로 넘어가시기를 바랍니다.
즐공하세요 🙂
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2024. 06. 21. 22:46
안녕하세요 🙂
8장 이전에 4장에서 UART 를 Test 하는 Lab 이 있습니다.
그 lab 은 성공하셨을까요?
build 가 성공적으로 되면 잘 되어야 할 것 같아요.
4장 성공했는데, 8장은 UART 가 안나온다 하시면..
빌드까지 하시고 Launch 까지 하셨는데 원인은 잘 모르겠네요.
버전을 맞춰주시는게 좋을 것 같습니다. 2022.1 추천드립니다.
2024. 06. 23. 16:01
안녕하세요 맛비님
4장 실습은 정상동작 확인하였습니다.
근데 8장 UART부분 2022.1 기준으로 진행했는데 빌드랑 Launch까지는 정상적으로 되는데 UART부분이 계속 출력이 안나오네요 ㅠㅠ
2024. 06. 23. 18:16
안녕하세요 맛비님
VIVADO project 및 XDC파일은 맛비님이 올려주신 파일로 진행 후 VITIS에서 프로젝트 생성 후 보드에 Writing하니까 제대로 동작하네요..ㅎㅎ
VIVADO에서 XDC 생성하는 과정에서 제대로 bit stream이 생성되지 않은것인지... 의문스럽지만 실행은 잘 됩니다! 감사합니다 ㅎㅎ
2024. 06. 23. 23:29
음.. 차이점이 어떤게 있을지 잘 모르겠네요.
폴더 혹은 파일 diff 가 가능하시니까 기회되실때 차이점을 알고 가시는 것도 좋을 것 같아요.
즐공하세요 🙂
2024. 07. 17. 23:15
답변 감사합니다!
음... 해결방법이 좀.. 의아하긴 하네요..
BASE ADDR 라는 개념이, 시스템 상에 할당받은 address 인데,
Vivado 에서 System 구성시, Address value 와 같은 값이 셋팅되어야 할 것 같아서요.
vitis 에서 넘어오면서 이 부분을 자동으로 생성해 주었었고요.
된다고 하시기도 하고, 제가 모든 버전을 test 하기도 어려워서 ㅠ
혹시나 이글을 보시는 분들이 있다면, myflute 님의 해결방법에 참고 부탁드립니다.
감사합니다!!