미해결
설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)
코드 생성 후 시뮬레이션
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맛비님, 안녕하세요.
강의 잘 듣고 있습니다.
다름이 아니고, 영상 중에 첨부해주신 링크에 있는 예제를 시뮬레이션 하는 중에 질문이 생겼습니다.
따로 폴더를 만들어서 vi로 .v 파일을 만들어 코드를 입력하고, 맛비님의 예제 코드처럼 build 파일을 만들어서 시뮬레이션을 하려고 하면 에러가 뜹니다.
맛비님의 hello_world.v 처럼 우분투상에서만 시뮬레이션 결과를 보려면 어떤 식으로 환경을 설정하면 될까요?
링크 중에 한 예제에서는 ncsim을 사용하더라구요, 혹시 xsim으로 할 수 있는지 궁금합니다!
감사합니다.