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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 1장] Testbench 에서 Clock 생성하기 ( Clock 이 없는 디지털 회로 설계를 논하지 말라. )

ubuntu 에서 새로운 verilog 타이핑을 세팅하는 법

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현업자인지라 업무때문에 답변이 늦을 수 있습니다. (길어도 만 3일 안에는 꼭 답변드리려고 노력중입니다 ㅠㅠ)

  1. 강의에서 다룬 내용들의 질문들을 부탁드립니다!! (설치과정, 강의내용을 듣고 이해가 안되었던 부분들, 강의의 오류 등등)

  2. 이런 질문은 부담스러워요.. (답변거부해도 양해 부탁드려요)

    1. 개인 과제, 강의에서 다루지 않은 내용들의 궁금증 해소, 영상과 다른 접근방법 후 디버깅 요청, 고민 상담 등..

  3. 글쓰기 에티튜드를 지켜주세요 (저 포함, 다른 수강생 분들이 함께보는 공간입니다.)

    1. 서로 예의를 지키며 존중하는 문화를 만들어가요.

    2. 질문글을 보고 내용을 이해할 수 있도록 남겨주시면 답변에 큰 도움이 될 것 같아요. (상세히 작성하면 더 좋아요! )

  4. 먼저 유사한 질문이 있었는지 검색해보세요.

  5. 잠깐! 인프런 서비스 운영 관련 문의는 1:1 문의하기를 이용해주세요.

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해당 강의 5:57초 와 같은 화면을 생성하려면 어떻게 해야하나요?
예를 들어 cd chapter_1 을 하고나면 vi로 열 수 있는 파일이 tb_clock_generator인데, 이 것을 열면 이미 모든 정답 코드가 작성되어있어서요.

전 직접 작성해보고싶은데, 5:57과 같이 기본적인 Verilog 포맷(////와 함께 timescale이 입력되어있는 상황)을 시작하는 방법이 뭔가요?

또한 꼭 verilog포맷이 아니더라도 그냥 아무때나 빨리 새로운 메모장을 열고싶을 때의 단축키도 궁금합니다

 

감사합니다.

답변 2

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안녕하세요 :)

해당 내용은, 제가 이미 만들어 놓은거고요.

새로 만들고 싶으시면, 파일명을 달리해서 만드시면 될 것 같아요.

전 직접 작성해보고싶은데, 5:57과 같이 기본적인 Verilog 포맷(////와 함께 timescale이 입력되어있는 상황)을 시작하는 방법이 뭔가요?

음.. 저는 별도로 사용하는게 없고요. 복 붙 해서 사용합니다. (느낌상 있을 것 같긴한데.. 불편할 것 같아요)

 

또한 꼭 verilog포맷이 아니더라도 그냥 아무때나 빨리 새로운 메모장을 열고싶을 때의 단축키도 궁금합니다

저는 vi <새파일명> 으로 만듭니다.

이런건 취향이라.. 잘 찾아보시면 더 좋은게 있지 않을까요?

즐공하세요 :)

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안녕하세요, 인프런 AI 인턴이에요. verilog 세팅에 대한 질문이신 것 같은데요, verilog 개발 환경을 설정하는 방법에 대해서 알려드릴게요.

  1. Ubuntu에 Verilog 개발 환경 설치하기

    • sudo apt-get install iverilog 명령어를 사용하여 iverilog를 설치해주세요.
    • sudo apt-get install gtkwave 명령어를 사용하여 gtkwave를 설치해주세요.
  2. Verilog 코드 작성하기

    • 원하는 디렉토리로 이동한 뒤 vi <파일이름>.v 명령어를 사용하여 새로운 Verilog 파일을 생성합니다.
    • vi 편집기를 열게 되면, 해당 파일에 코드를 작성하실 수 있습니다.
  3. 코드 컴파일 및 실행하기

    • iverilog -o <출력파일이름>.o <파일이름>.v 명령어를 사용하여 Verilog 코드를 컴파일합니다.
    • vvp <출력파일이름>.o 명령어를 사용하여 컴파일된 파일을 실행합니다.
  4. 시뮬레이션 결과 확인하기

    • gtkwave <출력파일이름>.vcd 명령어를 사용하여 시뮬레이션 결과를 확인할 수 있는 gtkwave를 실행합니다.
    • gtkwave에서 시뮬레이션 결과를 확인하고 분석할 수 있습니다.

tb_clock_generator 파일을 열었을 때, 이미 모든 정답 코드가 작성되어 있는 경우에 대해서는 강의에서 직접적으로 설명하실 수 없는 점 양해 부탁드립니다. 단순히 새로운 verilog 파일을 생성하고 코드를 작성하시면 됩니다.

질문에 대한 보다 구체적인 설명이 필요하신 경우, 질문 내용을 더욱 자세히 알려주시면 더 도움을 드릴 수 있을 것 같아요.

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