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설계독학맛비's 실전 AI HW 설계를 위한 바이블, CNN 연산 완전정복 (Verilog HDL + FPGA 를 이용한 가속기 실습)

[AI HW Lab3] CNN Verilog HDL Practice 4 (FPGA)

pl과 ps의 동작주파수

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안녕하세요 맛비님.

  1. 23:42 초에 보시면, PL의 clock을 90 MHz로 맞춰주셨습니다. 그리고 Input Frequency가 33.33 MHz로 되어있는데, PS 즉 Arm processor의 동작주파수가 33.33MHz인가요?

  2. Arm processor의 zynq 내 정해져있는 건가요? 바꿀 수 있는 방법이 있는지 궁금합니다.

     

    감사합니다.!!

verilog-hdlfpga임베디드cnn

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설계독학맛비
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안녕하세요 :)

A1. 구글링 해보니, 다음 링크를 찾았습니다. PS 내의 PLL 모듈의 input clock 으로 사용되네요.

https://numato.com/kb/styx-use-xilinx-zynq-ps-pll-clocks-fpga-fabric/

A2. 바꿔서 해본적이 없어서, 확답은 못드릴 것 같은데요. 변경방법은..? gui 상으로 활성화가 되어 있으니 직접 Test 해보시고 결과 공유 부탁드립니다.

image

즐공하세요 :)

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