10강 진행중 어드레스 관련 에러

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설계독학맛비's 실전 FPGA를 이용한 HW 가속기 설계 (LED 제어부터 Fully Connected Layer 가속기 설계까지)

[FPGA 10장] FSM 기본코어 IDLE -> RUN -> DONE 모듈을 FPGA 에 올려보기 HW Sleep 함수 구현 (PS <-> PL 간의 통신 방법 익히기2) - 실습편

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안녕하세요 맛비님!

10강 진행 중 마지막 run as 시 아래와 같은 에러가 발생하여 진행이 불가능합니다 ㅠㅠ

10강 진행중 오류3.png

어드레스 관련 문제인거같은데 10강 진행중 오류2.png 10강 진행중 오류1.png

어드레스와 range 같은 값들이 이전 강의까지는 강의 속 맛비님과 동일하게 생성되다가 10강 진행할때는 상이한 값이 나오네요 개인적으로 이것과 연관이 있지않을까 예상을 해보는데 혹시 어떻게 진행해야하는지 질문 드립니다 ㅠㅠ

답변 1

지식공유자

안녕하세요 :)

헛.. 캡쳐해주신 부분은, PS 에서 AXI4-Lite 로 PL 영역의 IP접근시 사용할 Memory mapped address 입니다. (PS 는 주소로 PI 의 HW IP 에 접근) 저거는의심하고계신 부분 하고는 다른 문제 같다.. 라는 생각이 드네요.

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launch 하면서 발생하는거라,

FPGA 에서 중간에 jtag jumper 를 변경하거나 하신적이 있으실까요? 실행당시의 환경오류일 가능성도 있어보여서요.

한번더 영상하고 동일하게 같이 해보시고요.

재현되시면, 문제되는 프로젝트를 공유드라이브 링크로 주시면, 주말중에 확인해보겠습니다 :)

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