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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

안녕하세요 맛비님!

해결된 질문

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안녕하세요 맛비님, 수강 1회독을 마치고 FPGA강의를 수강하기 전, verilog실습을 본격적으로 시작하려고하는데 막히는 부분이 있어 질문드립니다

 

제가code.png이런식으로 맛비님이 제공해주신 코드파일과는 별개로 하나의 디렉토리(verilog_practice)를 만들고 거기서 알려주신 코드들을 실행해보려고 하는데요,

테스트 코드를 다음과 같이 작성하였고,

test.v.png테스트벤치 코드를 다음과 같이 작성해보았습니다.

tb_test.png그 후 맛비님이 제공해주신 코드 중 build의 내용을 복붙하여

build.png이 파일을 만들어준 뒤 ./build 를 입력해보니

doohyun@BOOK-DU0QT3V97L:~/verilog_practice$ ./build

-bash: ./build: Permission denied

이런 메세지가 뜹니다...

 

리눅스를 처음 사용하다보니 어렵네요,,,ㅜㅜ 어떻게 해결 가능할까요?

답변 2

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설계독학맛비
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안녕하세요 :)

build 라고 만드신 파일의 "실행권한" 이 없어서 발생한 문제 같아요.

chmod +x build

위 명령어를 치시고 다시 해보시겠어요?

==========================

ls -al 치시면 파일의 권한이 나오는데요,

https://conory.com/blog/19194

위 링크가 도움이 되실꺼에요.

 

리눅스가 원래 이러면서 배우는 거.. 입니다!! 좌절하지마셔요. 금방 적응하실 꺼에요.

(사실 모든 일이 다.. 삽질로 채득되는 거죠..? )

즐공하세요 :)

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윤두현
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아아 권한을 주었더니 그 부분의 문제는 해결된 것 같아요 감사합니다 :)

아무래도 리눅스도 익숙해져야하겠네요 ...!!

 

 

하지만

image

이런식으로 xsim.dir/work 이부분에서 동작이 멈추는 것 같은데 문법적인 오류는 아닌 것 같습니다... 어떻게 해결해야하나요??

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설계독학맛비
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안녕하세요 :)

제공해드린 코드와 비교해가면서 어디가 문제인지 찾아보셔야 할 것 같아요.

개인이 만든 코드와 환경은 봐드리지 않습니다.

즐공하세요 :)

 

에러 메세지를 보면, 디자인을 못찾는게 문제네요. 왜 못찾을까요..? (이름이 다른가?)

등등의 추론으로 해결하시면 좋을 것 같아요.

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윤두현
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imagetb_test.v

테스트 벤치 코드를 다음과 같이 수정하였는데도 동일한 결과가 나왔습니다...

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