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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

[HDL 4장] 저장을 위한 기본 로직! D FilpFlop 을 이해하기 (Latch 를 만들면 안돼요! Flip Flop 을 만드셔야 합니다.)

D F/F gate수와 Cell수의 관계

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D F/F gate count = 10 gates라 하셧는데 이게 synthesis 이후에 보이는 cell의 갯수인가요?

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설계독학맛비
지식공유자

안녕하세요 :)

D F/F gate count = 10 gates라 하셧는데 이게 synthesis 이후에 보이는 cell의 갯수인가요?

네 맞습니다.

digital logic 의 최종 목적지는 실리콘 웨이퍼 위의 gate level 이겠죠?

gate count 가 곧 Digital logic 의 Area 와 관련이 있고요. 이 Gate count 을 합성 전에 러프하게 계산할때, D F/F 1bit 을 10 gates 로 생각하고 계산합니다.

즐공하세요 :)

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