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설계독학맛비's 실전 Verilog HDL Season 2 (AMBA AXI4 완전정복)

[HDL 36장] AXI4 Interface - 이론편 Advance - 3부

locked access의 잠금 범위

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안녕하세요 🙂좋은 강의 감사드립니다

[1. 질문 챕터] : 36강 3:33

[2. 질문 내용] : locked access 에서 interconnect 전체를 잠그는 것인가요? 아니면 타겟 slave만 잠그는 것인가요?

[3. 시도했던 내용, 그렇게 생각하는 이유] : exclusive access는 slave의 특정 region만 잠그는 것으로 명확하게 이해가 되었습니다. 그런데 locked access 부분에서는 둘 중 어떤 것을 의미하는지를 잘 모르겠습니다.

 

================ 다음 내용은 읽어보시고 지우시면 됩니다.=================

질문 내용을 작성해주실 때, 위의 3단계로 제가 이해할 수 있게 작성해주시면 정확한 답변을 드릴 수 있을 것 같아요!!

현업자인지라 업무때문에 답변이 늦을 수 있습니다. (길어도 만 3일 안에는 꼭 답변드리려고 노력중입니다 ㅠㅠ)

  1. 강의에서 다룬 내용들의 질문들을 부탁드립니다!! (설치과정, 강의내용을 듣고 이해가 안되었던 부분들, 강의의 오류 등등)

  2. 이런 질문은 부담스러워요.. (답변거부해도 양해 부탁드려요)

    1. 개인 과제, 강의에서 다루지 않은 내용들의 궁금증 해소, 영상과 다른 접근방법 후 디버깅 요청, 고민 상담 등..

  3. 글쓰기 에티튜드를 지켜주세요 (저 포함, 다른 수강생 분들이 함께보는 공간입니다.)

    1. 서로 예의를 지키며 존중하는 문화를 만들어가요.

    2. 질문글을 보고 내용을 이해할 수 있도록 남겨주시면 답변에 큰 도움이 될 것 같아요. (상세히 작성하면 더 좋아요! )

  4. 먼저 유사한 질문이 있었는지 검색해보세요.

  5. 잠깐! 인프런 서비스 운영 관련 문의는 1:1 문의하기를 이용해주세요.

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답변 1

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안녕하세요 🙂

케바케.. 라고 답을 드릴 수 있을 것 같아요. 왜냐하면, 스펙에 명시되어 있지않고, (스펙에 명시되어 있다고 한들..) 안지키는 사람도 꽤 있어서, 어떻게 설계하느냐의 문제이기 때문인데요.

Locked access는 일반적으로 타겟 Slave만 잠그는 것을 의미합니다. 이는 프로세서가 특정한 동작을 수행하는 동안 다른 마스터가 해당 자원에 접근하지 못하도록 보장해주는 방식입니다.

제가 "일반적으로" 라는 워딩을 사용한 이유는 간혹 "고급 SoC" (모든 회사의 SoC 를 들여다 볼 수 없어서 정확하게 뭐다 말씀드리기 어렵지만, 여기서 케바케가 등장합니다. )interconnect 설정에 따라 전체 버스 구조를 잠그거나 특정 라인만 잠글 수 있습니다.

  • Locked Access대부분 타겟 Slave만 잠그는 것을 의미합니다.

  • 단, 시스템의 interconnect 설정에 따라 잠금이 interconnect 전체에 영향을 미칠 수 있는 구조로 설정될 수 있습니다.

따라서 일반적인 경우에는 타겟 Slave에 대한 잠금으로 이해하고 접근하시면 됩니다. 다만 실제 설계하실 때 꼭 버스 구조를 봐주세요.

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