error 문제

설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

제공하는 실습파일 및 실행 환경에 대해 알아보아요. (수강자분들에게만 공유드려요~)

작성

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안녕하세요

./build하면 계속 오류가 뜨는데 이유를 모르겠어요 ㅠ

33번째줄 end가 오류라는데 왜 오류인지 모르겠어요

🙂

[1. 질문 챕터] : eg) 몇 장, 몇 분 몇 초 쯤. or 수강생 분들이 봤을 때 어디구나?! 할 수 있게 표기 부탁 드려요.

[2. 질문 내용] : eg) 질문 내용을 자유롭게 작성해주시면 되겠습니다 🙂

[3. 시도했던 내용, 그렇게 생각하는 이유] : eg) 설치영상은 이렇게 시도했는데 안되더라 or 본인의 생각을 적어주세요. (실습 내용 중에 이해가 안되거나 잘못된 내용이 있는데, 이러 이러한 근거로 나는 이렇게 생각합니다.)

================ 다음 내용은 읽어보시고 지우시면 됩니다.=================

질문 내용을 작성해주실 때, 위의 3단계로 제가 이해할 수 있게 작성해주시면 정확한 답변을 드릴 수 있을 것 같아요!!

현업자인지라 업무때문에 답변이 늦을 수 있습니다. (길어도 만 3일 안에는 꼭 답변드리려고 노력중입니다 ㅠㅠ)

강의에서 다룬 내용들의 질문들을 부탁드립니다!! (설치과정, 강의내용을 듣고 이해가 안되었던 부분들, 강의의 오류 등등)
이런 질문은 부담스러워요.. (답변거부해도 양해 부탁드려요)
1. 개인 과제, 강의에서 다루지 않은 내용들의 궁금증 해소, 영상과 다른 접근방법 후 디버깅 요청, 고민 상담 등..
글쓰기 에티튜드를 지켜주세요 (저 포함, 다른 수강생 분들이 함께보는 공간입니다.)
1. 서로 예의를 지키며 존중하는 문화를 만들어가요.
2. 질문글을 보고 내용을 이해할 수 있도록 남겨주시면 답변에 큰 도움이 될 것 같아요. (상세히 작성하면 더 좋아요! )
먼저 유사한 질문이 있었는지 검색해보세요.
잠깐! 인프런 서비스 운영 관련 문의는 1:1 문의하기를 이용해주세요.

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verilog-hdl fpga 임베디드

답변 2

설계독학맛비

지식공유자

안녕하세요 🙂

$finish 옆에 ";" 이 없는 것 같아요.

이렇게 해보시겠어요?

$finish;

인프런 AI 인턴

안녕하세요, 인프런 AI 인턴입니다.

박성현님의 질문에 대해, 유사한 상황을 겪었던 다른 학습자들의 질문과 그에 대한 답변을 참고할 수 있는 링크를 찾았습니다. 여기서 문제인 ./build 과정에서 발생한 에러 및 end 키워드 관련 오류 해결방안에 대한 정보를 얻을 수 있을 것 같습니다.

”./build 에러 관련 질문드립니다.”에서는 Vivado Simulator 사용 중 발생한 문법 오류에 대한 질문입니다. 답변에서는 syntax error가 코드 확인을 요구한다며 제공된 코드와 비교해볼 것을 권장하고 있습니다.
”./build 에러가 발생합니다”에서는 비슷한 상황에서 발생한 빌드 에러에 대한 질문으로, 제공된 코드에서의 실수 혹은 오타로 인해 발생 가능성을 지적하며, 에러 메세지가 명시한 라인을 확인할 것을 제안하고 있습니다.

질문하신 문제를 해결하기 위해서는 해당 오류 메세지가 나타나는 코드 라인을 주의 깊게 확인해 보시길 바랍니다. 정확한 코드 문제나 오타, 혹은 Vivado 사용법과 관련된 오류일 가능성이 있습니다. 에러 메시지를 통해 제시된 힌트를 바탕으로 문제의 원인을 찾으실 수 있을 것입니다.

저는 질문자님의 이해를 돕고자 지식공유자님의 기존 답변을 참고하여 유사한 답변 링크를 추천해드리고 있습니다.
현재 베타 기능으로 답변이 만족스럽지 않을 수 있는 점 양해 부탁드립니다. 🙏
추가적으로 궁금한 점이 있으시면, 이어서 질문해 주세요. 곧 지식공유자께서 답변해 주실 것입니다.

인프런 커뮤니티 질문&답변

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