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설계독학맛비's 실전 Verilog HDL Season 1 (Clock부터 Internal Memory까지)

메모리 반도체에서 Verilog 활용 방안에 대해서 궁금합니다.

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안녕하세요 맛비님.

 

강의가 재밌어서 열심히 듣다보니 구매한지 3일만에 season 1 강좌 수강을 80% 마무리했습니다. 감사합니다.

 

이제 곧 FPGA 설계 강좌를 수강할 예정인데 메모리 반도체 분야에서도 이렇게 HW 가속기 설계 실습을 해본 것이 + 요인이 될지가 궁금합니다. (결국 메모리 반도체 설계에서는Verilog 코딩 경험이 검증에서만 쓰이는 것이 아닌지...?)

 

삼성전자는 S.LSI 사업부가 있기 때문에 이쪽으로 지원을 할 예정이지만

 

SK 하이닉스의 경우 메모리 반도체만 진행하고 있기 때문에 나중에 지원할 때 HW 가속기 설계 경험을 어필해도 괜찮은건지, 괜찮다면 어떻게 어필하는 것이 좋을지 조언해주시면 감사드리겠습니다..!

 

또한, 차량용 반도체 SOC 설계 분야에서도 이러한 HW 가속기 설계 경험을 어필해도 괜찮은 것일까요?

 

아직 초반이라 감이 잘 안잡혀서 이렇게 질문드립니다.

 

감사합니다!!

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안녕하세요 🙂

다음에는 수강중이신 강의내용과 관련된 질문을 부탁 드립니다. 수강생이라는 이유로 강의 외 질문까지 모두 케어해드리면.. 이 부분은 양해 부탁드려요. (질문글 쓰실때 보이는 "질문 안내문" 확인 부탁드릴께요)

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Verilog HDL 은 현재 현업씬에의 설계에서 많이 사용하는 언어입니다.

검증은 System Verilog 를 이용해서 하는 추세이고요.

메모리 반도체에서는 말씀해주신대로 Verilog 가 주가 아닐 것 같아요.

하이닉스와 같은 회사에서도, HW 가속기 설계 경험을 적어주시는것도 plus 가 될 것 같습니다. (접점이 있긴때문에, 이력서에 쓰시면 도움이 되실꺼에요)

다만 뽑는 포지션의 종류에 따라서 main 으로 할지 sub 로 작성할지를 정하시는건 용호님이 결정하시면 될 것 같아요.

즐공하세요 🙂

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