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Verilog FPGA Program 1 (Arty A7-35T)

RAM ip를 이용하여 FIFO 기능을 구현할 수도 있나요?

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안녕하세요, IP에서 Block RAM 강의 부분 듣고 있는데 질문이 있어서 글 올립니다.

 

FIFO를 구현해보고 싶은데 아무래도 강의에 나와있는 부분은 RAM이다 보니 배운 부분을 응용하는게 어떨까 생각했습니다.

FIFO IP가 따로 있는 것은 알고 있지만, RAM IP를 이용하여 FIFO처럼 기능 구현을 할 수 있나요??

Single Dual Port RAM를 쓰면 FIFO처럼 구현할 수 있을 것 같은데 맞는지 궁금합니다.

 

답변 부탁 드립니다. 감사합니다.

답변 1

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구현 가능합니다. 어차피 fifi ip도 메모리를 이용하여 구현합니다. Write, read 클락이 동일하면 쉽고, 다르면 여러가지 추가적으로 구현해 주어야 힙니다. 직접 구현하고 sim 해보면 많은 도움이 됩니다. 감사합니다~!!

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