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맛비님 안녕하세요!
FSM에 대해서 질문이 있습니다.
강의에서는 3개의 state를 가진 core를 control하는 FSM을 예시로 설명해주셨는데,
여기서 말하는 core가 뭔지 궁금합니다.
또한 기능에 따라서 state가 여러개로 늘어날 수 있나요?! 몇 개까지 가능한가요?!
NPU의 control unit에 들어가는 FSM은 보통 내부에서 몇번의 연산이 수행되는지 궁금합니다!
답변 주시면 정말 감사하겠습니다!
늘 좋은 강의 감사합니다!
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설계독학맛비
지식공유자
안녕하세요 😀
A1. Core 는 연산을 담당하는 로직을 의미합니다. 그 Core 를 control 하기위한 controller 가 필요하고요.
회로 설계에서는 대부분 (제 경험상 거의 모든) FSM 을 이용하여 Control 로직을 설계합니다.
A2. 이론상 무한대 까지 가능합니다. 개수 제한은 설계자가 두겠죠. Verilog HDL 문법에 정의되어 있지 않습니다.
A3. NPU 내에 FSM 이 들어가는 로직이 많아서, 보통 제 경험상 10개 이하의 state 로 구성합니다. 몇번의 연산이냐.. 이거는 케바케라 답변드리기 어렵네요.
즐공하세요 :)